FPGA/ASIC Design Engineer — HDL & Verification
Avaneidi · Milano, Lombardia ·
Avaneidi in Lombardia is seeking an FPGA/ASIC Hardware Engineer to design, simulate, and verify digital circuits for high-performance FPGA and ASIC solutions. You will work with software teams to integrate hardware blocks into products.
Candidates should have HDL experience, strong timing analysis, and hands-on with Vivado/Quartus. The role emphasizes fast-paced collaboration and rigorous verification using testbenches and UVM.
Dati di mercato di EasyWorkClub, non forniti dal datore di lavoro
Retribuzione tipica per Ingegnere progettista a Milano: 36.500 € – 47.500 €, da 141 annunci
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